自介檔案: 本人擁有verilog四年以上寫作經驗, 小從學校的作業,
大到承接公司外包的模組都有。
屬性: 個人-兼職
所在地: 台灣
聯絡方式: 站內信
專長: verilog
接案地區: 不限
接案屬性:
附註: 以往在接verilog case, 都是以客戶的spec為主,
程式完成後, 會出一張波形圖給客戶, 波形圖滿意以後,
就付款拿程式。
作品介紹: 慣用平台Altera。 Xilinx和lattice也都有使用經驗。
曾寫過馬達控制模組, JPEG HW/SW codesign, 影像辨識模組,
....族繁不及備載~
anyway, 有任何需求請email來詳談 :)
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※ 編輯: antis 來自: 219.71.3.22 (04/29 17:44)