→ CuckooBoy:full懂了,parallel還是不懂,可以針對它再說明白一點嗎? 01/07 23:55
→ CuckooBoy:multiplexer-like?沒聽過....那是什麼?書上怎麼沒提到? 01/07 23:55
→ capric:嗯，明天再寫詳細一點，沒想到會被m ^^" 01/08 01:25
→ CuckooBoy:平行的含意可以順便講一下嗎?口以嗎?^^"S 01/08 08:59
※ 引述《CuckooBoy (阿書)》之銘言：
: 在學Verilog時,遇到一個問題...
: 請問full_case 和 parallel_case 兩者的HDL有什麼差別?
這是synthesis時才會有影響，simulation時則沒差
原則上避免使用，免得RTL與Netlist的function不符
full_case假設所有可能的情形都已經被考慮
因此，不需要加default statement
合成時將不會產生latch
parallel_case則是會產生multiplexer-like的電路
而不是一個priority的電路
大致上是這樣子，有錯請指正 ^^"
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