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Instruction Register ALU Data Register Frequency fetch read operation access write load 2ns 1ns 1ns 2ns 1ns 40% store 2ns 1ns 1ns 2ns 30% r-format 2ns 1ns 1ns 1ns 15% branch 2ns 1ns 1ns 10% Jump 2ns 5% I-cache miss rate 3% D-cache miss rate 10% miss penalty 12 cycle 答案 average CPI=(5*0.4+4*0.3+4*0.15+3*0.1+1*0.05)+3%*12+(40%+30%)*10%*12=5.35 想請問其中那個乘以比例的 5、4、4、3、1這些數字要怎麼計算出來呢? 謝謝 -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 61.231.109.120
volleyer:那是代表各個指令執行一次所分別需要的clock cycles 08/17 23:06
volleyer:(有錯請指正@@) 08/17 23:06
volleyer:而經過多少stage就需要多少clock cycles 08/17 23:10
B0038412:5 4 4 3 1 你對照每個指令所需stage 應該可以看出54431 08/17 23:32