我好像快要可以畢業了....
很多因素，不完全是我的東西都做完了...
因為老闆 6/20 要出國,七月多才回來~而我很可能七月中就要去當兵~
他本來說那我們七月口試好了，我一聽心都涼掉了~
就只好亂凹一些有的沒的，所以老闆也同意六月中口試~
其實我的東西還沒有做完...
我的論文是 FPGA 跟 DSP 的合作運算~
主要的名堂在 FPGA 上，我要用 FPGA 算出通道係數，然後送到 DSP 上做運算~
DSP 上的運算很單純，只是量很大，其實沒什麼東西好講~
主要就是在通道係數的產生...
這個部分我已經做的差不多了，但是我的 DSP 板子送修去，一直沒有回來...
說真的，就算回來以後，要把通道係數從 FPGA 上送到 DSP 上也是工程一件...
那是技術性的問題，並沒有什麼學術上的價值~
總之,我就決定以通道係數產生器來畢業了...
覺得很心虛，因為我的東西沒有全部做完...:~~~
老師問我，你做這個東西有沒有什麼突破或者貢獻?
我也是很心虛的掰了一些出來....
最後就是老師也半信半疑的同意用這樣的東西六月中畢業..
可是我真的很心虛啊...
實在是沒有什麼貢獻或突破....
哎呀....
這就是我讀了兩年研究所的成果啊..:~~~~
總之，論文先寫完，走一步算一步...
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