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http://203.71.42.75/fpga/sos/g11.jpg
請問圖中
1. 為什麼並列出輸出有兩個?
2. 1 -1 -1 1 為什麼會出現上面的0 0 1 1
可不可以說一下 串轉並的.........計算方法跟原理
因為我用vhdl中的串轉並.....程式
他是用移位的 output(3:0)=reg(2:0)&input(1)
輸出是3 downto 0的資料
但從這張圖看到的好像是一筆一筆 不是4-bit資料耶
而且reg不是預設都是0000嗎?
一個clk來不就 0001 001-1?.......怪怪的
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作者: Acme ( ) 看板: Electronics
標題: Re: 有人看得懂圖中的意思嗎?
時間: Wed Sep 7 14:56:22 2005
※ 引述《cuckoo691210.bbs@bbs.cs.nthu.edu.tw (小書)》之銘言：
: ───────────────────────────────────────
: http://203.71.42.75/fpga/sos/g11.jpg
: 請問圖中
: 1. 為什麼並列出輸出有兩個?
看起來是每收集兩個位元就同時把他們兩往外丟
當然要兩個了
先收1,再收0,然後同時丟出 1
0
再收0,再收1,再丟出 0
1
: 2. 1 -1 -1 1 為什麼會出現上面的0 0 1 1
1為high , -1為low呀
: 可不可以說一下 串轉並的.........計算方法跟原理
就是先把serial的,先收集好,然後在同時往外丟...沒啥計算也沒啥原理
: 因為我用vhdl中的串轉並.....程式
: 他是用移位的 output(3:0)=reg(2:0)&input(1)
: 輸出是3 downto 0的資料
: 但從這張圖看到的好像是一筆一筆 不是4-bit資料耶
: 而且reg不是預設都是0000嗎?
: 一個clk來不就 0001 001-1?.......怪怪的
這一段,不知所云
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