推 cebelas: peak current mode 還是average current mode 10/17 19:06
→ cebelas: 交大吳重雨教授 香港大學Philip mok 北科賴炎生教授 10/17 19:09
→ cebelas: 找這三個人的論文吧 或者是我直接私信給你 10/17 19:09
→ cebelas: 交大陳科宏老師也有許多篇相關的 到國圖找找吧 10/17 19:13
各位前輩好
小弟目前遇到一個問題
關於DCDC converter 電流控制法
在網路上找到的資料(paper)通常只提到能讓整個電路 control to output的小訊號分析
變成只有一個pole 跟一個 zero
如此一來穩定度的分析上，補償器容易實現phase margin > 45度
但是關於inner loop(current loop)跟outer loop(voltage loop)的相關推導
好像不容易找到
所以想要請問前輩們是否有什麼paper 或 note 有對於電流控制的相關推導
麻煩各位大師提點!
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