[問題] 請問各位有關高速訊號量測波形的問題

[CCMAKE (夏夜晚風)]

各位大大好
小弟對於高速訊號量測波形一直有一些疑問存在

我們常常可以看到量測高速差分訊號的波形圖(如PCIe)
例如下面網頁中的眼圖
http://bbs.ednchina.com/BLOG_ARTICLE_3028280.HTM
我一直有個疑問
就是這個波形是用示波器probe量測板子上的那個測點得來的呢?
是一出chip 的TX訊號嗎?
會有這個疑問的原因是
我看到的waveform
幾乎都是以中心點為0V 上下震盪數百mV的波形
在我的理解中
PCIe是走AC coupling
transmitter跟receiver都是會有自己working的DC bias
然後用AC電容隔開   兩邊的bias互不干擾
所以看到的波形應該是要在一個DC bias上 做上下震盪的波形
但是為什麼會看到的都是在0V +/- 幾百mV的波形呢?
這應該不是differential(就是P跟N相減之後)的結果吧?
應該是single-ended 的訊號量測
而且我們的晶片裡面應該不可能有負電壓存在
所以我覺得比較合理的波形圖應該是要看到像下面這個網頁的第二個圖一樣
http://bbs.ednchina.com/BLOG_ARTICLE_3027790.HTM
是在一個VCM的上下震盪的訊號
但是實際上看到的圖卻都不是這樣


還是說這些示波器在量測的時候
已經設成AC mode了?
只會去看AC成分的波形?

這個問題已經困擾我一段時間
也在外面的課堂上問過其他老師
但是一直都沒有一個滿意的答覆
希望有做高速訊號相關設計的大大可以不吝伺教
感激不盡啊!!!

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※ 文章網址: https://www.ptt.cc/bbs/Electronics/M.1444311103.A.15B.html
推 luckyBF: 差動探棒？
→ CCMAKE: 我在PCIE 測試中看到的  都是SMP接頭的connector
→ CCMAKE: 照理說應該都是單端訊號量測
→ CCMAKE: 除非是在示波器裡面做數學運算把PN訊號做相減
→ CCMAKE: 但是我只是想要了解  單端訊號為什麼不是在一個bias上
→ CCMAKE: 坐上下震動的波形    XD
推 cajole145: 第一種的眼圖是疊過(累積很多個EYE)   是差動探棒量的
→ cajole145: 吧!
推 cajole145: Pre-emphasis 翻成預加重.....ㄜ.....
→ kronos: 差動探棒無誤
→ CCMAKE: 請問樓上兩位大大  公司裡面有量測儀器嗎?
→ CCMAKE: 想了解一下   量測治具是怎麼樣設計的
→ CCMAKE: 我看到的量測治具  是 TX+一個SMP接頭  TX-一個量測接頭
→ CCMAKE: 請問兩位大大   你們的差動探棒 是透過甚麼治具去量測PN的
推 cajole145: 差動就兩個接點 P N    單端探棒一端是接地  要不要上
→ cajole145: 太克或安捷倫網站看一下差動探棒原理跟接點???
→ CCMAKE: c大  感謝回覆! 我知道差動探棒的接點   只是在PCIE量測
→ CCMAKE: 的公板上  所有的點應該都是單端接點  然後測試結果波形
→ CCMAKE: 是差動訊號量測的結果  所以才會有此疑問
→ CCMAKE: 公板長的像這樣  http://0rz.tw/poUp3
→ CCMAKE: 而我看過的差動探棒長的像這樣  http://0rz.tw/MkO10
→ CCMAKE: 應該不可能用這種差動探棒接到公板的SMP接頭上
→ CCMAKE: 所以我才會想說是不是示波器本身做了兩個channel相減處理
→ CCMAKE: 而不是直接用差動探棒量測板子所得到的結果  XD
推 yudofu: 差動探棒還是有一個地方可以接地呀 你就算用兩個高級的主
→ yudofu: 動探棒還是沒有差動探棒的匹配性好，不然差動探棒要賣誰？
→ CCMAKE: hi y大  我了解差動探棒比較好 所以才會覺得為什麼PCIe
→ CCMAKE: 量測的公板要做成單端的訊號測點  @_@