[問題] HSPICE跑到一半停止

[davison (davison)]

我目前用HSPICE模擬類比前端電路，包含AMP、SDM、LDO、OSC等，

各自模擬這些ANALOG BLOCK，.TRAN都可以順利跑完，

但是將這些BLOCK整合在一起，.TRAN跑到一半就會自動停止，

但是.LIST沒有出現ERROR或NON-CONVERGENCE等訊息，

加入.OPTION GSHUNT=10E-12 CSHUNT=10E-17、.OPTION ITL1=500、

.OPTION POST METHOD=GEAR GMIN=1E-20，.TRAN仍舊沒辦法跑完

想請問各位大大要如何解決目前所碰到的問題，謝謝

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→ zadarler: 換版本跑跑看
→ relax321: 不知道你是不是在EDA上面執行
→ relax321: 我有次經驗是.tr0檔案過大就被砍掉了
推 jamtu: 可能是資料量太大，硬碟滿了，或是系統管理者自動砍
→ jamtu: 此時你應該要設定只存部分點的資料，不要全部存
→ jamtu: 尤其是SDM吃資料量超大，裡面node超多，建議只存重要的來看
→ jamtu: 比如只存每個sub-block的input/output即可
→ davison: 我有用probe讀取某些關鍵節點電壓，所以tro只有600MEG
→ davison: 目前已用不同版本跑，看能否跑完
推 shengyeh: log 的error message 看一下 有沒有線索
推 shengyeh: 抱歉 沒注意到你說沒有錯誤訊息 不過這樣更怪
→ mmonkeyboyy: top一下 一般是硬碟寫不進去就會停
→ mmonkeyboyy: 另一種是LICENSE太少
→ zadarler: License不夠應該連跑都不能跑 有檢查過是否是quota爆掉
推 mmonkeyboyy: 你用MULTICORE他會RUNTIME去吃  因為我發生過這種問
→ mmonkeyboyy: 題 最後是發現吃多了Q_Q