[問題] verilog tb

[eamansf96xs (草爺)]

想問個問題 一般我們tb 是在寫的時候 是正緣給值還是負緣給值
不知道哪個才正確（假設我的電路正緣動作）

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推 escorpion: 我會提早正緣一點給值，不過如果是rtl simulation的話
→ escorpion: 沒差，反正就算剛好在正緣那刻給值也會讀進去
→ eamansf96xs: 如果有含delay呢？
→ eamansf96xs: rtl如果剛好正緣給值 第一級的ff會在下次正緣才是你
→ eamansf96xs: 前一次的值哦
→ eamansf96xs: 所以他不會直接正緣讀進去哦 在rtl情況下
→ eamansf96xs: 但是在place & route的時候會直接讀進去
→ eamansf96xs: 所以我現在就卡在 到底我要正緣給值還負緣給值
→ r901042004: 負緣給值最快
→ r901042004: 不過要注意sdc的input delay設定
→ eamansf96xs: 所以都是負緣給值 我這樣說對嗎？
→ eamansf96xs: 正常電路  正緣給值 負緣給值 都會對嗎？
推 r901042004: 應該這樣說，在testbench給值用<=比較不會出錯，尤其
→ r901042004:
→ r901042004: 是input要直接丟進去block給FF存起來時，你會發現FF
→ r901042004:
→ r901042004: 長得跟組合電路一樣，以上講的是正緣的時候
→ eamansf96xs: 自從用了負緣給值我就很少用#了
→ eamansf96xs: 怎樣才算是好的tb呀...
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※ 編輯: eamansf96xs (101.9.224.175), 06/22/2018 08:41:21
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→ eamansf96xs: 感謝m大意見