→ ery001: 均可，看自己熟哪個流程 12/06 09:06
→ ery001: 基本上在業界兩種方式都存在 12/06 09:08
各位版上的先進好：
最近剛接觸設計fractional N PLL, 對於裡面的ddsm設計流程有所疑問。
想請問版上的先進， ddsm在有了設計規格後，設計流程該怎麼執行？是一般的數位電路
設計流程嗎？就是用verilog然後synthesis gate level然後模擬這樣嗎？想說不可能直
接用transistor level custom design...由於不是很清楚整個可靠的flow,希望各位不吝
賜教...
感激不盡...
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