[問題] hspice看mos開關的阻抗

[zzxcaa (hanmak)]

各位好

我有個p型n型mos互接而成的開關，想觀察不同size所示的阻抗大小
當p型gate端給VDDD，n型gate端給0v理論上電晶體關閉，Ron很大
我在hspice的輸入給個ac=1v Vcm=0.5v 串聯0v電壓源
再用ac=1v電壓除以不同頻率下流過0v電壓源的電流
可以得到不同頻率下所看到的輸入阻抗
然而此輸入阻抗實部大概只有幾百歐姆反而是虛部好幾M歐姆等級(DC頻率下)
和我下LX8的指令求出RN跟RP並聯的數值有出入

本身是有用過此方法單看一個理想rc並聯，看高頻的輸入實虛部阻抗，
和用手算出來的結果無差別。
但把此方法用在看mos開關，理論上很低的頻率看不太到虛部的部分
而且實部因為mos開關關閉要很大才對。
想問一下這樣的模擬方法正確嗎? 有甚麼盲點呢?

謝謝!!

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推 smartbit: Ac=1 怎麼可以看到DC呢？而且DC頻率下怎麼還有實部 虛
→ smartbit: 部？
→ smartbit: 你的描述矛盾點太多了，而且看一個off switch input imp
→ smartbit: edance ？
→ smartbit: Off switch drain current 只剩leakage part
→ smartbit: Leakage current 你研究他的frequency response ？
推 smartbit: 而parasitic cap path 也無法看出來，因為gate 你給了fi
→ smartbit: xed voltage
→ zzxcaa: 我指的dc頻率是很低頻率的意思可能只有1k這樣不是指0
→ zzxcaa: 我主要的問題是這樣的看法在很低頻率時看到的輸入阻抗為
→ zzxcaa: 什麼是虛部很大實部不大
→ zzxcaa: 主要是心血來潮，想說理論off swith 應該是要看到無限大
→ zzxcaa: 的實部跟很小的虛部，但用這樣的看法卻是相反@@
→ zzxcaa: 如你所說只有leakage part除下來阻抗的確是很大沒錯 但跟
→ zzxcaa: 我下Lx8看ro 的數值有出入
→ zzxcaa: 結果 我把ac頻率掃低一點就看到無限大的實部了... 已解決