推 kdjf: 高速傳輸線吃的電力，跟直接放50R電阻到參考中間電位一樣大 06/06 17:59
→ kdjf: 線本身的電容已經無法忽略 06/06 18:00
推 supergoal: 阻抗匹配吧 06/08 08:52
→ supergoal: ddr4以後好像有省電模式 06/08 08:53
推 taipoo: 降低負載效應造成的偏差問題 06/08 10:56
推 ckha3b8: 吸收channel上的noise 06/13 21:27
請教各位大大
DDR Bus Terminator這種IC的功能是甚麼呢?
看了幾個網站的介紹(TI/Richtek/GStek)
架構大概輸入用一個能source和sink電流的LDO(應該都是A等級的大推力)
LDO的輸出再去推DDR Memory的input
可是DDR memory的input只是差動放大器的gate
(一端放參考電壓,另一端接LDO的輸出,在我認知只是一個電壓比較器)
需要這麼強的推力做甚麼呢?
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