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大家好 目前正在做除頻器的專題 這幾天終於能夠除2.25 但問題操作頻率不夠高 問題應該出在W/L的值 但實在不知道SCL那邊要怎麼調整 如果能夠降低swtich的rise time應該可以再往上提 下面附上電路圖 https://i.imgur.com/hv8TynA.jpg
https://i.imgur.com/9bLJDDg.jpg
https://i.imgur.com/As2BeVL.jpg
https://i.imgur.com/ZdocTda.jpg
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HenryLin123: W/L大一點電流就大了? 03/10 08:13
deepdish: 要不要問問chatGPT比較快 03/10 17:32
deepdish: https://i.imgur.com/6iU93Pt.png 03/10 17:33
zx32762498: 設計於Fmax:先大幅增加clock transistor的width->增 03/21 23:02
zx32762498: 加電流,再小幅增加differential pair&cross couple的 03/21 23:03
zx32762498: width->讓VGS變小->clock transistor的VDS變大->電流 03/21 23:03
zx32762498: 上升 03/21 23:03
FuryX: 你應該先分析你的除頻器哪裡是電流源哪裡是開關 07/29 18:53
FuryX: 感覺你都只給Typical size頻率當然上不去xD 07/29 18:53