推 funboy820: 這是我想到的case 12/21 14:33
→ kev72806: 你列的不太正確，Fully 是每一格都用的到，應該 Cache 1 12/21 18:47
→ kev72806: 要跟 Cache 2 大小一樣才比較有說服力 12/21 18:47
第9題.
http://miupix.cc/pm-93GYPZ
我的想法是這樣 他說在同樣使用LRU replacement 方法下舉出一個使用direct-map 比fully associative miss rate還低的例子
我覺得如果是同cache size 同block size direct怎樣應該都不會比fully好
頂多1block的時候一樣而已
寫到時間快到就亂掰了一個
http://miupix.cc/pm-ENES49
不知道這樣可不可行
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