→ mistel: AMAT=hit time +miss rate莪iss penalty10/11 21:46
→ DLHZ: 你要不要把你的假設打出來 這部分套amdahl公式而已10/11 21:46
→ Aa841018: 我是假設原本的沒有cache只有Main memory,然後新的增加10/11 22:19
→ Aa841018: 一個L1 cache。10/11 22:19
→ Aa841018: Tu表示level 1 hit time,Tm表示Main memory hit time,10/11 22:26
→ Aa841018: 然後T1同時表示Main memory的hit time?.....我就是卡在10/11 22:26
→ Aa841018: 這,latency到底是不是hit time啊?10/11 22:26
→ Aa841018: 意思是我要寫解答的答案或是Tm/(Tu+(1-H)*Tm)都可以嗎(10/11 22:28
→ Aa841018: 如果T1=Tm的話)………感覺總有哪裡不太對10/11 22:28
→ ekids1234: 其實我也被搞混了 一開始會覺得 T1 是 miss penalty10/11 22:58
→ ekids1234: 不過 也許他說的T1是 load all data from lower 的總時10/11 22:59
→ ekids1234: 所以 penalty 要套 Tm ? 我的理解是這樣10/11 23:00
→ ekids1234: 不過這是看了答案後才這樣想的10/11 23:00
→ mistel: 我覺得all data stored in lower level memory那句只是指10/11 23:27
→ mistel: 下層的記憶體就是最底層了...我覺得應該沒有特別的意思@@10/11 23:27
※ 編輯: Aa841018 (110.28.8.124 臺灣), 10/12/2019 06:16:26
→ Aa841018: 謝謝,我懂了! 10/12 07:50