[心得] 數位IC設計面試心得

[omg999 (我愛吃肉)]

（代PO)
手機排版傷眼請見諒

近期面試了多個數位IC設計的職位
常受惠於ptt 的資訊，因此決定來回饋一下
以下幾乎為板上經常拿來比較的那幾間公司所問的題目

1. 設計出一個Deglitch filter，將1 cycle和2 cycle的pulse濾除，並讓3 cycle或3 cy
cle以上的pulse通過(用verilog code 寫出來）

2. 用2對1 MUX，以及1跟0畫出XOR閘

3. if else/三元運算子/case所合成出來的電路有何差異

4. 說明blocking & non-blocking差異

5. 說明setup time & hold time定義，並以T_setup, T_hold, T_period, T_latency這
幾個參數用不等式表示在setup/hold time中的關係

6. 為什麼要滿足setup time & hold time

7. 什麼是亞穩態（通常接續上一題）

8. 亞穩態在stable後值會stable在1或0

9. 若發生setup time & hold time violation分別該怎麼處理

10. 在CDC中如何避免亞穩態

11. 2 flip flop跟3 flip flop有什麼差別

12. 從快domain（100MHz)傳到慢domain (10MHz)該用什麼方式處理？若快domain傳送一
個週期的pulse，慢domain也要是一個週期的pulse又該怎麼處理？

13. 針對做過的案子提出問題，例如：面積還能怎麼優化、怎麼做power gating、新增fe
ature後整個路徑的timing要怎麼去處理、RTL simulation環境怎麼跑、如何確認模擬結
果是正確的？

14. 針對FPGA合成提出問題，例如：合成環境、timing report check、FPGA simulation
怎麼做、硬體環境是什麼？

以上的setup time & hold time 以及CDC問題基本上是每場面試必問。
最後祝大家身體健康，職涯順利。




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推 bencer3283  : 推
推 csgod1325   : 蠻基本的問題
推 leoc554     : 硬體就是輕鬆 不用刷題
推 humorforever: 推
推 yesheyman   : 刷題至少有考古參考 硬體沒題庫要參考啥？
推 ttokin      : 硬體白版題題庫無上限 從實例到理論 類比更是有趣
→ lolpklol0975: 推哦
推 konodiode   : 推
推 jackhanhan  : 跟我面試時的題目87趴像
推 fcuk9981    : 推
推 ts05593818  : 推一個
推 soga0806    : 推
推 max853211   : 好簡單欸 大學生都會
推 Fernanda    : 推
推 ufo559      : 推推
推 nctudaniel  : 面試官：我又要重新想題目了啦！
推 MAGICMCGRADY: 軟體面試很多又不只考刷題...有的是直接叫你實作一
→ MAGICMCGRADY: 個小功能，就算刷題也很多沒考古的
→ MAGICMCGRADY: 只能說各有各的難處，只是軟體面試煩得是要花很多
→ MAGICMCGRADY: 時間額外準備沒辦法說面就面
推 lianteh     : 謝謝分享，有分享就該推
推 k798976869  : 之前面試遇到的也87%像
推 mtkinside   : 這些列的都是基本觀念 做過HW designer都會知道
→ mtkinside   : 剛畢業的還是需要準備一下基本問答(async.meta sta
→ mtkinside   : ble.STA.TMAX.low power..)
→ mtkinside   : 最近收到google HR的來信 直接說不考coding
推 lovemost    : 2 4 5 6 9 這幾題我會....其他都不會QQ
推 iamala      : 其實有幾題我也要想一下，不過平常我知道誰會就好X
→ iamala      : D 但感謝分享。有些google面試也會問...
推 ayn775437403: 都是經典考題 謝謝分享
→ ayn775437403: 長見的應該還有除頻器之類的簡單電路
推 s755369     : 除頻器狂考+1 MNR三間都問
推 wju1230     : 基本歸基本  7~11真的實務上遇過好幾個人不會
推 HotDogCC    : 推 謝謝分享