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小弟研究所畢業晶片是做 10 Gbps wireline RX (Adaptive EQ + CDR) 而最近晶片要回來了所以要開始製作 PCB 而目前在製作 RX 的前端通道上出了一些小問題 我用 PCB Layout 軟體畫了兩條差動線 這兩條差動線寬度跟間距都有依照特徵阻抗的要求去計算 而因為 PCB 大小版的限制,又因為我 RX 前置通道是 0.7m 所以在 PCB 的 layout 上要走蛇線,最後再把側插 SMA 焊上去 用示波器量了兩個差動訊號發現有 Skew,大約 200多ps 換算一下 10 Gbps 的資料也將近 2.x UI 因為我是故意要在 RX 輸入端做出一個通道,所以需要畫很長走線的差動訊號 所以想請教一下,在畫這種長走線的差動訊號又要走蛇線的方式 如何讓 skew 量變小 ? 另外想請教一下,市面上買得到這種故意做出 ISI 效應的 PCB 板子嗎 ? -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 140.115.73.211 ※ 文章網址: https://www.ptt.cc/bbs/comm_and_RF/M.1451287487.A.095.html
obov: 怎摸弄的可以弄到200ps 50.148.161.199 12/28 16:48
sora10032: 朝聖 140.115.73.146 12/28 17:45
yuhengcheng: 這不是115哇沙米嗎?!?! 140.115.73.227 12/28 17:47
df870151: 推115哇沙米 140.115.73.111 12/28 17:50
gn01216674: 蛇形間距有跑仿真嗎?繞的太近高頻會 223.137.53.126 12/29 09:36
gn01216674: 飛過去 223.137.53.126 12/29 09:36
gn01216674: 繞蛇線DP,DN線長有等長嗎?一般是5mil 223.137.53.126 12/29 09:38
gn01216674: 內 223.137.53.126 12/29 09:38
dysyase: 地圍之!洞打之!大絕招:[是德]借之!PCIe 114.38.100.149 12/29 15:48
dysyase: 騎車想到,你應該是要做RX靈敏度的實驗! 114.38.98.63 12/30 09:28
dysyase: 問問看CIC有沒有衰減器(圓柱狀,兩端SMA, 114.38.98.63 12/30 09:29
dysyase: 網路測試VNA會用到)用PCB會有焊工的影響 114.38.98.63 12/30 09:32
dysyase: 還會有板廠製程的影響,另SMA線好壞有差! 114.38.98.63 12/30 09:35
dysyase: 平常沒有好好收的話,線可能有問題了! 114.38.98.63 12/30 09:36